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-- Copyright (C) 1991-2007 Altera Corporation
-- Your use of Altera Corporation's design tools, logic functions
-- and other software and tools, and its AMPP partner logic
-- functions, and any output files from any of the foregoing
-- (including device programming or simulation files), and any
-- associated documentation or information are expressly subject
-- to the terms and conditions of the Altera Program License
-- Subscription Agreement, Altera MegaCore Function License
-- Agreement, or other applicable license agreement, including,
-- without limitation, that your use is for the sole purpose of
-- programming logic devices manufactured by Altera and sold by
-- Altera or its authorized distributors. Please refer to the
-- applicable agreement for further details.
--
-- This is a Quartus II output file. It is for reporting purposes only, and is
-- not intended for use as a Quartus II input file. This file cannot be used
-- to make Quartus II pin assignments - for instructions on how to make pin
-- assignments, please see Quartus II help.
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-- NC : No Connect. This pin has no internal connection to the device.
-- DNU : Do Not Use. This pin MUST NOT be connected.
-- VCCPGM : Dedicated power pin for configuration, which MUST be connected to 1.8V, 2.5V or 3.0V depending on the needs of the configuration device.
-- VCCINT : Dedicated power pin, which MUST be connected to VCC (1.2V).
-- VCCIO : Dedicated power pin, which MUST be connected to VCC
-- of its bank.
-- Bank 1: 3.3V
-- Bank 2: 3.3V
-- Bank 3: 3.3V
-- Bank 4: 3.3V
-- Bank 5: 3.3V
-- Bank 6: 3.3V
-- Bank 7: 3.3V
-- Bank 8: 3.3V
-- GND : Dedicated ground pin. Dedicated GND pins MUST be connected to GND.
-- It can also be used to report unused dedicated pins. The connection
-- on the board for unused dedicated pins depends on whether this will
-- be used in a future design. One example is device migration. When
-- using device migration, refer to the device pin-tables. If it is a
-- GND pin in the pin table or if it will not be used in a future design
-- for another purpose the it MUST be connected to GND. If it is an unused
-- dedicated pin, then it can be connected to a valid signal on the board
-- (low, high, or toggling) if that signal is required for a different
-- revision of the design.
-- GND+ : Unused input pin. It can also be used to report unused dual-purpose pins.
-- This pin should be connected to GND. It may also be connected to a
-- valid signal on the board (low, high, or toggling) if that signal
-- is required for a different revision of the design.
-- GND* : Unused I/O pin. For transceiver I/O banks (Bank 13, 14, 15, 16 and 17),
-- connect each pin marked GND* either individually through a 10 kohm resistor
-- to GND or tie all pins together and connect through a single 10 kohm resistor
-- to GND.
-- For non-transceiver I/O banks, connect each pin marked GND* directly to GND
-- or leave it unconnected.
-- RESERVED : Unused I/O pin, which MUST be left unconnected.
-- RESERVED_INPUT : Pin is tri-stated and should be connected to the board.
-- RESERVED_INPUT_WITH_WEAK_PULLUP : Pin is tri-stated with internal weak pull-up resistor.
-- RESERVED_INPUT_WITH_BUS_HOLD : Pin is tri-stated with bus-hold circuitry.
-- RESERVED_OUTPUT_DRIVEN_HIGH : Pin is output driven high.
---------------------------------------------------------------------------------
---------------------------------------------------------------------------------
-- Pin directions (input, output or bidir) are based on device operating in user mode.
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Quartus II Version 7.2 Build 151 09/26/2007 SJ Web Edition
CHIP "swankmania_HDL" ASSIGNED TO AN: EP2C35F672C6
Pin Name/Usage : Location : Dir. : I/O Standard : Voltage : I/O Bank : User Assignment
-------------------------------------------------------------------------------------------------------------
GND : A2 : gnd : : : :
VCCIO3 : A3 : power : : 3.3V : 3 :
GND* : A4 : : : : 3 :
GND* : A5 : : : : 3 :
GND* : A6 : : : : 3 :
GND* : A7 : : : : 3 :
GND* : A8 : : : : 3 :
GND* : A9 : : : : 3 :
GND* : A10 : : : : 3 :
VCCIO3 : A11 : power : : 3.3V : 3 :
GND : A12 : gnd : : : :
iSwitch[9] : A13 : input : 3.3-V LVTTL : : 4 : Y
GND* : A14 : : : : 4 :
GND : A15 : gnd : : : :
VCCIO4 : A16 : power : : 3.3V : 4 :
GND* : A17 : : : : 4 :
GND* : A18 : : : : 4 :
GND* : A19 : : : : 4 :
GND* : A20 : : : : 4 :
GND* : A21 : : : : 4 :
GND* : A22 : : : : 4 :
GND* : A23 : : : : 4 :
VCCIO4 : A24 : power : : 3.3V : 4 :
GND : A25 : gnd : : : :
GND* : AA1 : : : : 1 :
GND* : AA2 : : : : 1 :
GND* : AA3 : : : : 1 :
GND* : AA4 : : : : 1 :
GND* : AA5 : : : : 1 :
GND* : AA6 : : : : 1 :
GND* : AA7 : : : : 1 :
VCCA_PLL1 : AA8 : power : : 1.2V : :
ioSRAM_IO[3] : AA9 : bidir : 3.3-V LVTTL : : 8 : Y
ioSRAM_IO[4] : AA10 : bidir : 3.3-V LVTTL : : 8 : Y
ioSRAM_IO[6] : AA11 : bidir : 3.3-V LVTTL : : 8 : Y
GND* : AA12 : : : : 8 :
oLEDR[10] : AA13 : output : 3.3-V LVTTL : : 7 : Y
oLEDR[8] : AA14 : output : 3.3-V LVTTL : : 7 : Y
GND* : AA15 : : : : 7 :
GND* : AA16 : : : : 7 :
GND* : AA17 : : : : 7 :
GND* : AA18 : : : : 7 :
VCCA_PLL4 : AA19 : power : : 1.2V : :
oLEDG[6] : AA20 : output : 3.3-V LVTTL : : 7 : Y
GND_PLL4 : AA21 : gnd : : : :
VCCIO6 : AA22 : power : : 3.3V : 6 :
oHex1[5] : AA23 : output : 3.3-V LVTTL : : 6 : Y
oHex1[4] : AA24 : output : 3.3-V LVTTL : : 6 : Y
oHex3[1] : AA25 : output : 3.3-V LVTTL : : 6 : Y
oHex3[2] : AA26 : output : 3.3-V LVTTL : : 6 : Y
GND* : AB1 : : : : 1 :
GND* : AB2 : : : : 1 :
GND* : AB3 : : : : 1 :
GND* : AB4 : : : : 1 :
VCCIO1 : AB5 : power : : 3.3V : 1 :
VCCIO8 : AB6 : power : : 3.3V : 8 :
GND : AB7 : gnd : : : :
oSRAM_A[16] : AB8 : output : 3.3-V LVTTL : : 8 : Y
VCCIO8 : AB9 : power : : 3.3V : 8 :
ioSRAM_IO[5] : AB10 : bidir : 3.3-V LVTTL : : 8 : Y
GND : AB11 : gnd : : : :
oHex0[1] : AB12 : output : 3.3-V LVTTL : : 8 : Y
VCCIO8 : AB13 : power : : 3.3V : 8 :
VCCIO7 : AB14 : power : : 3.3V : 7 :
GND* : AB15 : : : : 7 :
GND : AB16 : gnd : : : :
VCCIO7 : AB17 : power : : 3.3V : 7 :
GND* : AB18 : : : : 7 :
GND : AB19 : gnd : : : :
GND* : AB20 : : : : 7 :
oLEDR[2] : AB21 : output : 3.3-V LVTTL : : 7 : Y
VCCIO7 : AB22 : power : : 3.3V : 7 :
oHex2[0] : AB23 : output : 3.3-V LVTTL : : 6 : Y
oHex1[6] : AB24 : output : 3.3-V LVTTL : : 6 : Y
oHex2[5] : AB25 : output : 3.3-V LVTTL : : 6 : Y
oHex2[4] : AB26 : output : 3.3-V LVTTL : : 6 : Y
GND* : AC1 : : : : 1 :
GND* : AC2 : : : : 1 :
GND* : AC3 : : : : 1 :
GND : AC4 : gnd : : : :
oSRAM_A[2] : AC5 : output : 3.3-V LVTTL : : 8 : Y
oSRAM_A[3] : AC6 : output : 3.3-V LVTTL : : 8 : Y
oSRAM_A[12] : AC7 : output : 3.3-V LVTTL : : 8 : Y
oSRAM_A[17] : AC8 : output : 3.3-V LVTTL : : 8 : Y
ioSRAM_IO[14] : AC9 : bidir : 3.3-V LVTTL : : 8 : Y
ioSRAM_IO[15] : AC10 : bidir : 3.3-V LVTTL : : 8 : Y
oSRAM_CE_ : AC11 : output : 3.3-V LVTTL : : 8 : Y
oHex0[2] : AC12 : output : 3.3-V LVTTL : : 8 : Y
iSwitch[6] : AC13 : input : 3.3-V LVTTL : : 8 : Y
oLEDR[11] : AC14 : output : 3.3-V LVTTL : : 7 : Y
GND* : AC15 : : : : 7 :
GND* : AC16 : : : : 7 :
GND* : AC17 : : : : 7 :
GND* : AC18 : : : : 7 :
GND* : AC19 : : : : 7 :
GND* : AC20 : : : : 7 :
oLEDR[7] : AC21 : output : 3.3-V LVTTL : : 7 : Y
oLEDR[3] : AC22 : output : 3.3-V LVTTL : : 7 : Y
GND* : AC23 : : : : 6 :
NC : AC24 : : : : :
oHex2[2] : AC25 : output : 3.3-V LVTTL : : 6 : Y
oHex2[3] : AC26 : output : 3.3-V LVTTL : : 6 : Y
VCCIO1 : AD1 : power : : 3.3V : 1 :
GND* : AD2 : : : : 1 :
GND* : AD3 : : : : 1 :
oSRAM_A[4] : AD4 : output : 3.3-V LVTTL : : 8 : Y
oSRAM_A[5] : AD5 : output : 3.3-V LVTTL : : 8 : Y
oSRAM_A[8] : AD6 : output : 3.3-V LVTTL : : 8 : Y
oSRAM_A[9] : AD7 : output : 3.3-V LVTTL : : 8 : Y
ioSRAM_IO[0] : AD8 : bidir : 3.3-V LVTTL : : 8 : Y
GND : AD9 : gnd : : : :
oSRAM_OE_ : AD10 : output : 3.3-V LVTTL : : 8 : Y
oHex0[3] : AD11 : output : 3.3-V LVTTL : : 8 : Y
oLEDR[17] : AD12 : output : 3.3-V LVTTL : : 8 : Y
iSwitch[5] : AD13 : input : 3.3-V LVTTL : : 8 : Y
GND : AD14 : gnd : : : :
oLEDR[12] : AD15 : output : 3.3-V LVTTL : : 7 : Y
GND* : AD16 : : : : 7 :
GND* : AD17 : : : : 7 :
GND : AD18 : gnd : : : :
GND* : AD19 : : : : 7 :
VCCIO7 : AD20 : power : : 3.3V : 7 :
oLEDR[6] : AD21 : output : 3.3-V LVTTL : : 7 : Y
oLEDR[4] : AD22 : output : 3.3-V LVTTL : : 7 : Y
oLEDR[5] : AD23 : output : 3.3-V LVTTL : : 7 : Y
GND* : AD24 : : : : 6 :
GND* : AD25 : : : : 6 :
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GND* : H16 : : : : 4 :
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GND : K20 : gnd : : : :
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GND : P12 : gnd : : : :
GND : P13 : gnd : : : :
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GND : P15 : gnd : : : :
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GND* : P17 : : : : 6 :
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GND : R1 : gnd : : : :
oHex6[0] : R2 : output : 3.3-V LVTTL : : 1 : Y
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oHex5[4] : R5 : output : 3.3-V LVTTL : : 1 : Y
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GND* : R8 : : : : 1 :
VCCIO1 : R9 : power : : 3.3V : 1 :
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VCCINT : R11 : power : : 1.2V : :
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GND* : R19 : : : : 6 :
ioGPIO1[14] : R20 : bidir : 3.3-V LVTTL : : 6 : Y
GND : R21 : gnd : : : :
nSTATUS : R22 : : : : 6 :
CONF_DONE : R23 : : : : 6 :
ioGPIO1[13] : R24 : bidir : 3.3-V LVTTL : : 6 : Y
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GND : R26 : gnd : : : :
VCCIO1 : T1 : power : : 3.3V : 1 :
oHex5[0] : T2 : output : 3.3-V LVTTL : : 1 : Y
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GND : T5 : gnd : : : :
GND* : T6 : : : : 1 :
iSwitch[13] : T7 : input : 3.3-V LVTTL : : 1 : Y
GND* : T8 : : : : 1 :
oHex5[3] : T9 : output : 3.3-V LVTTL : : 1 : Y
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VCCINT : T11 : power : : 1.2V : :
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